Σχεδιασμός και προσομοίωση λειτουργίας του VSM επεξεργαστή σε γλώσσα VHDL
Design and simulation of operation of the VSM processor in VHDL language
![Thumbnail](/xmlui/bitstream/handle/11400/4281/Massios_45585.pdf.jpg?sequence=6&isAllowed=y)
Keywords
Επεξεργαστής ; VHDL ; VSMAbstract
Η παρούσα διπλωματική εργασία ασχολείται με το σχεδιασμό και την προσομοίωση λειτουργίας επεξεργαστή VSM σε γλώσσα VHDL. Κύριο χαρακτηριστικό των επεξεργαστών αυτής της οικογένειας είναι οι μικρές τους διαστάσεις αλλά και η απλότητα του σχεδιασμού τους.
Abstract
The present thesis concerns the design and simulation of VSM processor operation in VHDL language. The main feature of the processors of this family is their small dimensions but also the simplicity of their design.